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摘要:

       FPGA原型設(shè)計人員艱苦努力所得的明顯回報就是ASIC設(shè)計可以及時而毫無問題地完成產(chǎn)品定案流片(tape-out)。不過,原型設(shè)計還有一點日益重要的優(yōu)勢,即ASIC或SoC中嵌入的軟件在項目開發(fā)的早期階段便可與實際速度硬件進(jìn)行完美集成。

 

 

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